南阳理工学院电子系EDA实验教程

第一部分 图形法设计部分 实验一：组合逻辑３-８译码器的设计

（Quartus II软件的基本操作与应用）

说明：本书将以实验一为例详细介绍Altera公司Quartus II软件的基本应用，其它实验将不再赘述。读者在通过本实验后将对Quartus II软件及CPLD的设计与应用有一个比较完整的概念和思路。在此因篇幅有限，仅仅介绍了Quartus II软件的最基本、最常用的一些基本功能。相信读者在熟练使用本软件以后，你会发现该软件还有好多非常方便、快捷、灵活的设计技巧与开发功能。

一、实验目的：

1、掌握组合逻辑电路的设计方法。 2、掌握组合逻辑电路的静态测试方法。

3、初步掌握Quartus II软件的基本操作与应用。 4、初步了解可编程器件的设计全过程。

二、实验步骤：

（一）设计输入

1）打开Quartus II 8.0开发软件，选择File-〉New Project Wizad。弹出工程向导对话框，点击Next。

2）在第一行位置指定工程要保存的目录，如D:\\Training，在第二行位置填入工程名decoder38

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和顶层实体名decoder38，再点击Next。

3）点击Next。

4）若实验所使用的是Cyclone系列的“EP2C35Q672C6”，点击Finish，工程创建完成。此时只是配置了与工程相关的一些基本设置，在开发过程中如需要，仍然可以通过菜单Assignments ->Settings来修改。

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5）新建文件：打开File->New，选择Device Design Files子类中的Block Diagram/Schematic File，点击OK，创建一个顶层文件。

6）出现下面所示界面，在界面上双击鼠标左键

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