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微机原理与接口技术试题（1）
试卷编号：
( 1)卷
课程编号： H61030010 课程名称： 微机原理与接口技术 考试形式： 闭卷
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适用班级： 姓名： 学号： 班级：
学院： 信息工程 专业： 计算机科学技术
考试日期：
考生注意事项：1、本试卷共 6 页，请查看试卷中是否有缺页或破损。如有立即举手报告以便更换。
2、考试结束后，考生不得将试卷、答题纸和草稿纸带出考场。
一、填空题(每空 1 分，共 15 分)
1.RESET 信号到来后 8088/86 的 CS 和 IP 分别为 _FFFF_H 和_0000_H。
2. 在特殊全嵌套方式下，8259 可响应 同级或高级 中断请求。3. CPU 与外设接口通过 数据
总线传送状态信号与命令信号。4. 8255 有 3 种工作方式, 其中 方式 2
只允许5. 有地址重迭现象的译码方式为 部分译码 A 和 口使用。线选法
。6. 外设端口的编址方式有 I/O 端口独.立编址
和 I/O 端口与存储器统一编址
。7.INT8253 采用 BCD 码计数时，其最大计数值为__10000__，此时的计数初值为 __0000__。
8.8088/8086 的 AD7-AD0 是地址数据复用引脚，在 T1 时传送__地址信号__。 9.8259A 作为主片时其引脚 CAS0-CAS2 的信息传送方向是_向外_。
10.RS-232C 是适用于__数据终端设备 DTE__和__数据通信设备 DCE__间的接口。二、 单项选择题(每小题 1 分，共 20 分)
1. 8086CPU 寻址 I/O 端口最多使用( 4 )条地址线。 (1)8 (2)10 (3)12 (4)16
2. CPU 执行 IN 指令时有效的信号组合是( 1 )。
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(1) RD =0, IO/M =1 (2) RD =0, IO/M =0
(3) WR =0, IO/M =1 (4) WR =0, IO/M =0 更多精品文档
第1页共6页 题号 一 二 三 四 五 六 七 八 九 十 总分 累分人 题分 15 20 10 20 15 20 100 签名 得分 得分 评阅人 得分 评阅人 学习-----好资料
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3.某计算机的字长是 16 位，它的存储器容量是 64KB，若按字编址那么它的最大 寻址范围是( 2 )。
(1)64K 字 (2)32K 字 (3)64KB (4)32KB
4.某一 SRAM 芯片的容量是 512×8 位，除电源和接地线外，该芯片的其他引脚最 少应为( 4 )根。
(1)25 (2)23 (3)21 (4)19
5.8088/8086 的基本总线周期由( 2 )个时钟周期组成。
(1)2 (2)4 (3)5 (4)6
6.在 8086 系统中中断号为 0AH，则存放中断向量的内存起始地址为( 2 )。
(1)0AH (2)28H (3)4AH (4)2AH
7.采用两片 8259A 可编程中断控制器级联使用，可以使 CPU 的可屏蔽中断扩大到 ( 1 )。
(1)15 级 (2)16 级 (3)32 级 (4)64 级
8.当 IF=0，8088/8086CPU 不响应( 2 )中断请求。
(1)INT N (2)INTR (3)NMI (4)INTO
9.8253 可编程定时器/计数器中，其二进制的最大计数初值为( 3 )。
(1)65536 (2)7FFFH (3)0000H (4)FFFFH
10.8086/88CPU 在响应中断时要执行( 2 )个中断响应周期。
(1)1 个 (2)2 个 (3)3 个 (4)4 个 11. 中断向量表是存放( 2 )的存储区域.
(1)中断类型号 (2)中断服务程序入口处地址 (3)中断断点地址 (4)程序状态字
12.INT8255 中可用置位/复位控制字对( 3 )的各位进行按位操作以实现某些控制
功能。
(1)A 口 (2)B 口 (3)C 口
(4)数据总线缓冲器 11.RS-232C 标准规定信号“0”和“1”的电平是( 3 )。
(1)0V 和+3V～+15V (2)-3V～-15V 和 0V (3) +3V 至+15V 和-3V～-15V (4)+3V～+15V 和-0V
12.对于开关型设备的控制，适合采用的 I/O 传送方式是( 1 )。
(1)无条件 (2)查询 (3)中断 (4)DMA
13. 传送数据时，占用 CPU 时间最长的传送方式是（1 ）。
（1）查询 （2）中断 （3）DMA （4）IOP
14. 既然是在数据传输率相同的情况下，那么，又说同步字符传输速度要高于
异步字符传输其原因是（ 2 ）。
（1）发生错误的概率少 （2）附加位信息总量少 （3）双方通信同步 （4）字符之间无间隔
巳知 DRAM2118 芯片容量为 16K×1 位, 若组成 64KB 的系统存储器,则组成的芯片组数和每个芯片组的芯片数为( 4 ).
(1)2 和 8 (2)1 和 16 (3)4 和 16 (4)4 和 8 中断屏蔽寄存储器的作用是( 2 ).
(1)禁止 CPU 响应外设的中断请求 (2)禁止外设向 CPU 发中断请求 (3)禁止软中断请求 (4)禁止 NMI 中断请求
15. 16.INT 8259