1）对阶：
[?E]补=[Ex]补+[-Ey]补 = 11,101+ 00,010=11,111 < 0，
应Ex向Ey对齐，则：[Ex]补+1=11，101+00，001=11，110 = [Ey]补 [x]补=1，110；0.010 110 2）尾数运算：
[Mx]补+[My]补= 0.010 110 + 11.100 100=11.111010 [Mx]补+[-My]补=0.010 110 + 00.011100= 00.110 010 3）结果规格化：
[x+y]补=11，110；11.111 010 = 11，011；11.010 000 （尾数左规3次，阶码减3）
[x-y]补=11，110；00.110 010, 已是规格化数。 4）舍入：无 5）溢出：无
-101
则：x+y=2×（-0.110 000）
-010
x-y =2×0.110 010
-011010
（2）x=2×（-0.100010）,y=2-×（-0.011111）
[x]补=1，101；1.011 110, [y]补=1，110；1.100 001
1） 对阶：过程同(1)的1），则 [x]补=1，110；1.101 111 2）尾数运算：
[Mx]补+[My]补= 11.101111 + 11. 100001 = 11.010000 [Mx]补+[-My]补= 11.101111 + 00.011111 = 00.001110 3）结果规格化：
[x+y]补=11，110；11.010 000,已是规格化数
[x-y]补=11，110；00.001 110 =11，100；00.111000 （尾数左规2次，阶码减
2）
4）舍入：无 5）溢出：无
-010
则：x+y=2×（-0.110 000）
-100
x-y =2×0.111 000
101100
（3）x=2×（-0.100 101）,y=2×（-0.001 111）
[x]补=0，101；1.011 011, [y]补=0，100；1.110 001 1）对阶：
[?E]补=00，101+11，100=00，001 >0，应Ey向Ex对齐，则： [Ey]补+1=00，100+00，001=00，101=[Ex]补 [y]补=0，101；1.111 000（1） 2）尾数运算：
[Mx]补+[My]补= 11.011011+ 11.111000（1）= 11.010011（1） [Mx]补+[-My]补= 11.011011+ 00.000111（1）= 11.100010（1） 2） 结果规格化：
[x+y]补=00，101；11.010 011（1），已是规格化数
[x-y]补=00，101；11.100 010（1）=00，100；11.000 101 （尾数左规1次，
阶码减1）
4）舍入：
[x+y]补=00，101；11.010 011（舍） [x-y]补 不变 5）溢出：无
101
则：x+y=2×（-0.101 101）
100
x-y =2×（-0.111 011）
32. 设机器字长为16位，分别按4、4、4、4和5、5、3、3分组后，
（1）画出按两种分组方案的单重分组并行进位链框图，并比较哪种方案运算速度快。 （2）画出按两种分组方案的双重分组并行进位链框图，并对这两种方案进行比较。 （3）用74181和74182画出单重和双重分组的并行进位链框图。 解：（1）4—4—4—4分组的16位单重分组并行进位链框图见教材286页图6.22。
5—5—3—3分组的16位单重分组并行进位链框图如下：
（2）4—4—4—4分组的16位双重分组并行进位链框图见教材289页图6.26。 5—5—3—3分组的16位双重分组并行进位链框图如下：
5—5—3—3分组的进位时间=2.5ty?3=7.5ty； 4—4—4—4分组的进位时间=2.5ty?3=7.5ty； 可见，两种分组方案最长加法时间相同。
结论：双重分组并行进位的最长进位时间只与组数和级数有关，与组内位数无关。 （3）单重分组16位并行加法器逻辑图如下（正逻辑）：
注意： 1）74181芯片正、负逻辑的引脚表示方法；
2）为强调可比性，5-5-3-3分组时不考虑扇入影响；
3）181芯片只有最高、最低两个进位输入/输出端，组内进位无引脚； 4）181为4位片，无法5-5-3-3分组，只能4-4-4-4分组；
5）单重分组跳跃进位只用到181，使用182的一定是双重以上分组跳跃进位； 6）单重分组跳跃进位是并行进位和串行进位技术的结合；双重分组跳跃进位
是二级并行进位技术；特别注意在位数较少时，双重分组跳跃进位可以采用全先行进位技术实现；位数较多时，可采用双重分组跳跃进位和串行进位技术结合实现。
第 七 章
1. 什么叫机器指令？什么叫指令系统？为什么说指令系统与机器的主要功能以及与硬件结构之间存在着密切的关系？ 答：参考P300。
2. 什么叫寻址方式？为什么要学习寻址方式？ 答：参看P310。
3. 什么是指令字长、机器字长和存储字长？ 答：略。
4. 零地址指令的操作数来自哪里？？各举一例说明。 答：零地址指令的操作数来自ACC，为隐含约定。
在一地址指令中，另一个操作数的地址通常可采用ACC隐含寻址方式获得。
5. 对于二地址指令而言，操作数的物理地址可安排在什么地方？举例说明。
答：对于二地址指令而言，操作数的物理地址可安排在寄存器内、指令中或内存单元内等。
8. 某机指令字长16位，每个操作数的地址码为6位，设操作码长度固定，指令分为零地址、一地址和二地址三种格式。若零地址指令有M条，一地址指令有N种，则二地址指令最多有几种？若操作码位数可变，则二地址指令最多允许有几种？ 解：1）若采用定长操作码时，二地址指令格式如下：
OP（4位） A1（6位） 4A2（6位） 设二地址指令有K种，则：K=2-M-N 当M=1（最小值），N=1（最小值）时，二地址指令最多有：Kmax=16-1-1=14种 3） 若采用变长操作码时，二地址指令格式仍如1）所示，但操作码长度可随地址码
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的个数而变。此时，K= 2 -（N/2 + M/2 ）；
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当（N/2 + M/2 ）?1时（N/2 + M/2 向上取整），K最大，则二地址指令最多有：Kmax=16-1=15种（只留一种编码作扩展标志用。）
9. 试比较间接寻址和寄存器间接寻址。 答：略。
10. 试比较基址寻址和变址寻址。 略。
11. 画出先变址再间址及先间址再变址的寻址过程示意图。 解：1）先变址再间址寻址过程简单示意如下： EA=[(IX)+A]，IX?(IX)+1
2）先间址再变址寻址过程简单示意如下：EA=(IX)+(A)，IX? (IX)+1
16. 某机主存容量为4M?16位，且存储字长等于指令字长，若该机指令系统可完成108种操
作，操作码位数固定，且具有直接、间接、变址、基址、相对、立即等六种寻址方式，试回答：（1）画出一地址指令格式并指出各字段的作用； （2）该指令直接寻址的最大范围； （3）一次间址和多次间址的寻址范围； （4）立即数的范围（十进制表示）； （5）相对寻址的位移量（十进制表示）； （6）上述六种寻址方式的指令哪一种执行时间最短？哪一种最长？为什么？哪一种便于程序浮动？哪一种最适合处理数组问题？
（7）如何修改指令格式，使指令的寻址范围可扩大到4M？
（8）为使一条转移指令能转移到主存的任一位置，可采取什么措施？简要说明之。 解：（1）单字长一地址指令格式：
OP（7位） M（3位） A（6位） OP为操作码字段，共7位，可反映108种操作； M为寻址方式字段，共3位，可反映6种寻址操作； A为地址码字段，共16-7-3=6位。
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（2）直接寻址的最大范围为2=64。
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（3）由于存储字长为16位，故一次间址的寻址范围为2；若多次间址，需用存储字的
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最高位来区别是否继续间接寻址，故寻址范围为2。 （4）立即数的范围为-32——31（有符号数），或0——63（无符号数）。 （5）相对寻址的位移量为-32——31。 （6）上述六种寻址方式中，因立即数由指令直接给出，故立即寻址的指令执行时间最短。间接寻址在指令的执行阶段要多次访存(一次间接寻址要两次访存，多次间接寻址要多次访存)，故执行时间最长。变址寻址由于变址寄存器的内容由用户给定，而且在程序的执行过程中允许用户修改，而其形式地址始终不变，故变址寻址的指令便于用户编制处理数组问题的程序。相对寻址操作数的有效地址只与当前指令地址相差一定的位移量，与直接寻址相比，更有利于程序浮动。
（7）方案一：为使指令寻址范围可扩大到4M，需要有效地址22位，此时可将单字长一地址指令的格式改为双字长，如下图示： OP（7位） MOD（3位） A（低16位） 方案二：如果仍采用单字长指令（16位）格式，为使指令寻址范围扩大到4M，可通过段寻址方案实现。安排如下： 硬件设段寄存器DS（16位），用来存放段地址。在完成指令寻址方式所规定的寻址操作后，得有效地址EA（6位），再由硬件自动完成段寻址，最后得22位物理地址。 即：
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物理地址=（DS）?2 + EA
注：段寻址方式由硬件隐含实现。在编程指定的寻址过程完成、EA产生之后由硬件自动完成，对用户是透明的。
方案三：在采用单字长指令（16位）格式时，还可通过页面寻址方案使指令寻址范
围扩大到4M。安排如下： 硬件设页面寄存器PR（16位），用来存放页面地址。指令寻址方式中增设页面寻址。当需要使指令寻址范围扩大到4M时，编程选择页面寻址方式，则：EA =（PR）‖A （有效地址=页面地址“拼接”6位形式地址），这样得到22位有效地址。 （8）为使一条转移指令能转移到主存的任一位置，寻址范围须达到4M，除了采用(7) 方
A（高6位）