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《数字系统设计》总复习题

19. 什么是库、程序包、子程序、过程调用、函数调用? 20. 怎样用VHDL语言描述时钟clk信号的上升沿? 21. 怎样用VHDL语言描述时钟clk信号的下降沿? 22. 怎样用VHDL语言描述同步复位信号? 23. 怎样用VHDL语言描述异步复位信号? 24. 为什么要层次化设计?

25. Moore型状态机和Mealy型状态机有什么相同和不同?

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下载:《数字系统设计》总复习题.doc

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