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VHDL

设计

 

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进制加减计数器状态机?/p>

VHDL

设计

 

 

一?/p>

 

【设计目的?/p>

 

学习并掌?/p>

Quartus II 

开发系统的基本操作?/p>

 

掌握?/p>

Quartus II

进行文本输入法进行电路设计、编译和仿真方法?/p>

 

掌握

CPLD/FPGA

的开发流程?/p>

 

掌握

EDA

实验开发系统的使用?/p>

  

掌握状态机的原理?/p>

 

掌握简单状态机?/p>

VHDL

设计方法

 

掌握计数器的设计方法?/p>

 

掌握带有复位和和时钟使能?/p>

10

进制计数器的原理?/p>

 

掌握通用计数器的设计方法?/p>

 

学习使用

VHDL

进行时序逻辑电路的设计?/p>

 

学习利用真值表编写

VHDL

程序?/p>

 

学习掌握

7

段数码显示译码器设计的原理?/p>

 

掌握

VHDL

语言方式设计

7

段数码显示译码器?/p>

 

学习掌握

8

位数码管动态扫描显示电路的原理?/p>

 

掌握

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语言设计

8

位数码管动态扫描显示电?/p>

 

学习

VHDL

语言设计较复杂的电路方法?/p>

 

 

 

二?/p>

 

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设计要求

 

 

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语言设计一个状态机,要求具有以下状态和功能中的四种?/p>

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复位功能

 

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数码管以任何方式闪动

 

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蜂鸣器发声或者播放一段音?/p>

 

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并用两位数码管将结果显示出来

 

 

本次设计选用的功能状态为

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进制加减计数器状态机?/p>

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一?/p>

 

【设计目的?/p>

 

学习并掌?/p>

Quartus II 

开发系统的基本操作?/p>

 

掌握?/p>

Quartus II

进行文本输入法进行电路设计、编译和仿真方法?/p>

 

掌握

CPLD/FPGA

的开发流程?/p>

 

掌握

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实验开发系统的使用?/p>

  

掌握状态机的原理?/p>

 

掌握简单状态机?/p>

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设计方法

 

掌握计数器的设计方法?/p>

 

掌握带有复位和和时钟使能?/p>

10

进制计数器的原理?/p>

 

掌握通用计数器的设计方法?/p>

 

学习使用

VHDL

进行时序逻辑电路的设计?/p>

 

学习利用真值表编写

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程序?/p>

 

学习掌握

7

段数码显示译码器设计的原理?/p>

 

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8

位数码管动态扫描显示电路的原理?/p>

 

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语言设计较复杂的电路方法?/p>

 

 

 

二?/p>

 

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设计要求

 

 

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A.

 

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一?/p>

 

【设计目的?/p>

 

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Quartus II 

开发系统的基本操作?/p>

 

掌握?/p>

Quartus II

进行文本输入法进行电路设计、编译和仿真方法?/p>

 

掌握

CPLD/FPGA

的开发流程?/p>

 

掌握

EDA

实验开发系统的使用?/p>

  

掌握状态机的原理?/p>

 

掌握简单状态机?/p>

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设计方法

 

掌握计数器的设计方法?/p>

 

掌握带有复位和和时钟使能?/p>

10

进制计数器的原理?/p>

 

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进行时序逻辑电路的设计?/p>

 

学习利用真值表编写

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学习掌握

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段数码显示译码器设计的原理?/p>

 

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二?/p>

 

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A.

 

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eda状态机的VHDL设计 - 百度文库
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掌握

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实验开发系统的使用?/p>

  

掌握状态机的原理?/p>

 

掌握简单状态机?/p>

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设计方法

 

掌握计数器的设计方法?/p>

 

掌握带有复位和和时钟使能?/p>

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进制计数器的原理?/p>

 

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学习使用

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进行时序逻辑电路的设计?/p>

 

学习利用真值表编写

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程序?/p>

 

学习掌握

7

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掌握

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语言方式设计

7

段数码显示译码器?/p>

 

学习掌握

8

位数码管动态扫描显示电路的原理?/p>

 

掌握

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语言设计

8

位数码管动态扫描显示电?/p>

 

学习

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语言设计较复杂的电路方法?/p>

 

 

 

二?/p>

 

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设计要求

 

 

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语言设计一个状态机,要求具有以下状态和功能中的四种?/p>

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A.

 

复位功能

 

B.

 

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C.

 

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D.

 

数码管以任何方式闪动

 

E.

 

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