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桂林航天工业学院

 

 

学年?/p>

 

学期

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

数字电子技?/p>

 

 

 

期末考试试题?/p>

A

卷答案)

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

适用?/p>

 

 

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电子工程系所有专?/p>

 

 

 

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考生注意?/p>

 

 

班别、学号?/p>

 

姓名

要准确?/p>

 

工整地填?/p>

 

在相应的

 

框格内?/p>

 

                                

               

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装订线内

 

 

 

 

 

 

 

 

不要答题

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

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评卷?/p>

 

 

 

 

 

 

 

 

 

 

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一?/p>

 

填空?/p>

(

每空

1

分,?/p>

20

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) 

1.

 

任意两个最小项之积恒为

_

_0_           

_

,全体最小项之和恒为

_    

_1

__

?/p>

 

2. N

个输入端的二进制译码器,共有

__

_

N

2

____

个输出端。对于每一组输入代码,

?/p>

___

_1_   

___

个输出端是有效电平?/p>

 

3.

 

在将两个多位二进制数相加时,除了最低位以外,每一位都应该考虑来自低位?/p>

进位,这种运算称?/p>

_

_

半加?/p>

       

__

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4.

存储

12

位二进制信息需?/p>

__

_

12_   _

__

个触发器?/p>

 

5. 

二进制数?/p>

10110

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2

=

10

(22)

   

十进制数?/p>

28

?/p>

10

=

2

(11100)

=

16

(

1

)

C

  

6. 

十进制数?/p>

56

?/p>

10

= 

8421

(01010110)

BCD

  

7.

按逻辑功能分类,触发器可分?/p>

_

_

RS

    _

__

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_

_

D

     _

_

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JK

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T

等四种类型?/p>

 

8.

对于

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,要使次?/p>

1

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=0,

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9. 

如图

1

所示逻辑电路的输?/p>

 

 

Y

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(图

1

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(图

2

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10.

如图所示,

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A+B 

 

 

 

 

 

 

 

 

 

 

11. 

逻辑运算?/p>

 A*0=_

_

0_

    _

      A+1= _

_

1

_    

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12.

多谐振荡电路?/p>

_

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个稳定状态,单稳态触发器?/p>

_

_

1

    __

个稳定状态?/p>

 

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D/A

转换器输入数字量的位数为

8

,该转换器的分辨率为

   

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桂林航天工业学院

 

 

学年?/p>

 

学期

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

数字电子技?/p>

 

 

 

期末考试试题?/p>

A

卷答案)

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

适用?/p>

 

 

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电子工程系所有专?/p>

 

 

 

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考生注意?/p>

 

 

班别、学号?/p>

 

姓名

要准确?/p>

 

工整地填?/p>

 

在相应的

 

框格内?/p>

 

                                

               

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装订线内

 

 

 

 

 

 

 

 

不要答题

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

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1.

 

任意两个最小项之积恒为

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_

,全体最小项之和恒为

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2. N

个输入端的二进制译码器,共有

__

_

N

2

____

个输出端。对于每一组输入代码,

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___

_1_   

___

个输出端是有效电平?/p>

 

3.

 

在将两个多位二进制数相加时,除了最低位以外,每一位都应该考虑来自低位?/p>

进位,这种运算称?/p>

_

_

半加?/p>

       

__

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4.

存储

12

位二进制信息需?/p>

__

_

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__

个触发器?/p>

 

5. 

二进制数?/p>

10110

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2

=

10

(22)

   

十进制数?/p>

28

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10

=

2

(11100)

=

16

(

1

)

C

  

6. 

十进制数?/p>

56

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= 

8421

(01010110)

BCD

  

7.

按逻辑功能分类,触发器可分?/p>

_

_

RS

    _

__

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_

_

D

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_

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JK

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等四种类型?/p>

 

8.

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,要使次?/p>

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9. 

如图

1

所示逻辑电路的输?/p>

 

 

Y

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(图

1

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(图

2

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10.

如图所示,

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11. 

逻辑运算?/p>

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_

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      A+1= _

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1

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12.

多谐振荡电路?/p>

_

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  _

_

个稳定状态,单稳态触发器?/p>

_

_

1

    __

个稳定状态?/p>

 

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D/A

转换器输入数字量的位数为

8

,该转换器的分辨率为

   

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桂林航天工业学院

 

 

学年?/p>

 

学期

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

数字电子技?/p>

 

 

 

期末考试试题?/p>

A

卷答案)

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

适用?/p>

 

 

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电子工程系所有专?/p>

 

 

 

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考生注意?/p>

 

 

班别、学号?/p>

 

姓名

要准确?/p>

 

工整地填?/p>

 

在相应的

 

框格内?/p>

 

                                

               

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装订线内

 

 

 

 

 

 

 

 

不要答题

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

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任意两个最小项之积恒为

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_0_           

_

,全体最小项之和恒为

_    

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2. N

个输入端的二进制译码器,共有

__

_

N

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____

个输出端。对于每一组输入代码,

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___

_1_   

___

个输出端是有效电平?/p>

 

3.

 

在将两个多位二进制数相加时,除了最低位以外,每一位都应该考虑来自低位?/p>

进位,这种运算称?/p>

_

_

半加?/p>

       

__

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4.

存储

12

位二进制信息需?/p>

__

_

12_   _

__

个触发器?/p>

 

5. 

二进制数?/p>

10110

?/p>

2

=

10

(22)

   

十进制数?/p>

28

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10

=

2

(11100)

=

16

(

1

)

C

  

6. 

十进制数?/p>

56

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10

= 

8421

(01010110)

BCD

  

7.

按逻辑功能分类,触发器可分?/p>

_

_

RS

    _

__

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_

_

D

     _

_

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JK

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T

等四种类型?/p>

 

8.

对于

D

触发器,若现?/p>

n

Q

= 0

,要使次?/p>

1

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n

Q

=0,

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9. 

如图

1

所示逻辑电路的输?/p>

 

 

Y

AB

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(图

1

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(图

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10.

如图所示,

Y= 

 

A+B 

 

 

 

 

 

 

 

 

 

 

11. 

逻辑运算?/p>

 A*0=_

_

0_

    _

      A+1= _

_

1

_    

_ 

12.

多谐振荡电路?/p>

_

_0 

  _

_

个稳定状态,单稳态触发器?/p>

_

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个稳定状态?/p>

 

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D/A

转换器输入数字量的位数为

8

,该转换器的分辨率为

   

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数字电子技术A卷题目资?- 百度文库
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学年?/p>

 

学期

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

数字电子技?/p>

 

 

 

期末考试试题?/p>

A

卷答案)

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

适用?/p>

 

 

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电子工程系所有专?/p>

 

 

 

?/p>

 

考生注意?/p>

 

 

班别、学号?/p>

 

姓名

要准确?/p>

 

工整地填?/p>

 

在相应的

 

框格内?/p>

 

                                

               

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装订线内

 

 

 

 

 

 

 

 

不要答题

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

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填空?/p>

(

每空

1

分,?/p>

20

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) 

1.

 

任意两个最小项之积恒为

_

_0_           

_

,全体最小项之和恒为

_    

_1

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2. N

个输入端的二进制译码器,共有

__

_

N

2

____

个输出端。对于每一组输入代码,

?/p>

___

_1_   

___

个输出端是有效电平?/p>

 

3.

 

在将两个多位二进制数相加时,除了最低位以外,每一位都应该考虑来自低位?/p>

进位,这种运算称?/p>

_

_

半加?/p>

       

__

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4.

存储

12

位二进制信息需?/p>

__

_

12_   _

__

个触发器?/p>

 

5. 

二进制数?/p>

10110

?/p>

2

=

10

(22)

   

十进制数?/p>

28

?/p>

10

=

2

(11100)

=

16

(

1

)

C

  

6. 

十进制数?/p>

56

?/p>

10

= 

8421

(01010110)

BCD

  

7.

按逻辑功能分类,触发器可分?/p>

_

_

RS

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D

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JK

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T

等四种类型?/p>

 

8.

对于

D

触发器,若现?/p>

n

Q

= 0

,要使次?/p>

1

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n

Q

=0,

则输?/p>

D=_

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9. 

如图

1

所示逻辑电路的输?/p>

 

 

Y

AB

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(图

1

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(图

2

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10.

如图所示,

Y= 

 

A+B 

 

 

 

 

 

 

 

 

 

 

11. 

逻辑运算?/p>

 A*0=_

_

0_

    _

      A+1= _

_

1

_    

_ 

12.

多谐振荡电路?/p>

_

_0 

  _

_

个稳定状态,单稳态触发器?/p>

_

_

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个稳定状态?/p>

 

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D/A

转换器输入数字量的位数为

8

,该转换器的分辨率为

   

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