初学者学?/p>
Verilog HDL
的步骤和经验技?/p>
Verilog
HDL
是一种硬件描述语言?/p>
HDL:Hardware
DiscripTIon
Language
?/p>
?
Verilog
HDL
语言是一种以文本形式来描述数字系统硬件的结构和行为的语言,用它可?/p>
表示逻辑电路图、逻辑表达式,还可以表示数字逻辑系统所完成的逻辑功能?/p>
Verilog HDL
?/p>
VHDL
是目前世界上最流行的两种硬件描述语言,都是在
20
世纪
80
年代
中期开发出来的。前者由
Gateway Design AutomaTIon
公司(该公司?/p>
1989
年被
Cadence
公司收购)开发。两?/p>
HDL
均为
IEEE
标准
Verilog HDL
语言学习用途就是在最广泛?/p>
C
语言的基础上发展起来的一种件描述语言?/p>
它是?/p>
GDA(Gateway Design AutomaTIon)
公司?/p>
PhilMoorby
?/p>
1983
年末首创的,
最初只
设计了一个仿真与验证工具,之后又陆续开发了相关的故障模拟与时序分析工具?/p>
1985
?/p>
Moorby
推出它的第三个商用仿真器
Verilog-XL,
获得了巨大的成功,从而使?/p>
Verilog
HDL
迅速得到推广应用?/p>
1989
?/p>
CADENCE
公司收购?/p>
GDA
公司,使?/p>
VerilogHDL
?/p>
为了该公司的独家专利?/p>
1990
?/p>
CADENCE
公司公开发表?/p>
Verilog
HDL,
并成?/p>
LVI
?/p>
织以促进
Verilog HDL
成为
IEEE
标准?/p>
?/p>
IEEE Standard 1364-1995.Verilog HDL
的最大特
点就是易学易用,
如果?/p>
C
语言的编程经验,
可以在一个较短的时间内很快的学习和掌握,
因而可以把
Verilog HDL
内容安排在与
ASIC
设计等相关课程内部进行讲授,
由于
HDL
?/p>
言本身是专门面向硬件与系统设计的,
这样的安排可以使学习者同时获得设计实际电路的
经验。与之相比,
VHDL
的学习要困难一些。但
Verilog HDL
?/p>
**
的语法,也容易造成?/p>
学者犯一些错误,这一点要注意?/p>
1.
首先讲一下为什么需要学习硬件描述语言?/p>
Hardware DescripTIon Language
?/p>
HDL
)硬
件描述语言是一种形式化方法描述数字电路和系统的语言?/p>
数字电路?/p>
应该是在大二上学
期左右学习的课程?/p>
是一门非常重要的课程?/p>
现在大学的可能主要集中在逻辑门和小规?/p>
集成电路的讲解上,很少涉及到
HDL
。当然,我们是可以通过一些列?/p>
74
系列芯片构成
我们想设计数字系统,但是当系统门数增多,
设计就会变得非常复杂和困难但是照样有?/p>
外用这个方法实现?/p>
8
位处理器,不过说实话?/p>
其成本和消耗的精力只能用来赚点眼球?