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实验二运算器实验

 

1.

算术逻辑运算实验

 

一

.

实验目的

 

1.

了解简单运算器的数据传输通路?/p>

 

2.

验证运算功能发生器的组合功能?/p>

 

3.

掌握算术逻辑运算加、减、与的工作原理?/p>

 

4.

验证实验台运算的

8

位加、减、与、直通功能?/p>

 

5.

按给定数?/p>

,

完成几种指定的算术和逻辑运算?/p>

 

?/p>

.

实验内容

 

1.

实验原理

 

算术逻辑单元

ALU

的数据通路如图

2-1

所示。其中运算器

ALU181

根据

74LS181

的功能用

VHDL

硬件描述语言编辑而成

,

构成

8

位字长的

ALU

。参加运?/p>

的两?/p>

8

位数据分别为

A[7..0]

?/p>

B[7..0],

运算模式?/p>

S[3..0]

?/p>

16

种组合决?/p>

,

?/p>

S[3..0]

的值由

4

?/p>

2

进制计数?/p>

LPM_COUNTER

产生

,

计数时钟?/p>

Sclk(

?/p>

2-1;

此外

,

?/p>

M=0,

选择算术运算

,M=1

为逻辑运算

,C N

为低位的进位?/p>

;F[7..0]

为输出结?/p>

,C O

为运算后的输出进位位。两?/p>

8

位数据由总线

IN[7..0]

分别通过两个电平锁存?/p>

74373

锁入

,ALU

功能如表

2-1

所示?/p>

 

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2-1 ALU181

的运算功?/p>

 

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实验二运算器实验

 

1.

算术逻辑运算实验

 

一

.

实验目的

 

1.

了解简单运算器的数据传输通路?/p>

 

2.

验证运算功能发生器的组合功能?/p>

 

3.

掌握算术逻辑运算加、减、与的工作原理?/p>

 

4.

验证实验台运算的

8

位加、减、与、直通功能?/p>

 

5.

按给定数?/p>

,

完成几种指定的算术和逻辑运算?/p>

 

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.

实验内容

 

1.

实验原理

 

算术逻辑单元

ALU

的数据通路如图

2-1

所示。其中运算器

ALU181

根据

74LS181

的功能用

VHDL

硬件描述语言编辑而成

,

构成

8

位字长的

ALU

。参加运?/p>

的两?/p>

8

位数据分别为

A[7..0]

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B[7..0],

运算模式?/p>

S[3..0]

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16

种组合决?/p>

,

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4

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产生

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为逻辑运算

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为低位的进位?/p>

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为输出结?/p>

,C O

为运算后的输出进位位。两?/p>

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分别通过两个电平锁存?/p>

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2-1 ALU181

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实验二运算器实验

 

1.

算术逻辑运算实验

 

一

.

实验目的

 

1.

了解简单运算器的数据传输通路?/p>

 

2.

验证运算功能发生器的组合功能?/p>

 

3.

掌握算术逻辑运算加、减、与的工作原理?/p>

 

4.

验证实验台运算的

8

位加、减、与、直通功能?/p>

 

5.

按给定数?/p>

,

完成几种指定的算术和逻辑运算?/p>

 

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.

实验内容

 

1.

实验原理

 

算术逻辑单元

ALU

的数据通路如图

2-1

所示。其中运算器

ALU181

根据

74LS181

的功能用

VHDL

硬件描述语言编辑而成

,

构成

8

位字长的

ALU

。参加运?/p>

的两?/p>

8

位数据分别为

A[7..0]

?/p>

B[7..0],

运算模式?/p>

S[3..0]

?/p>

16

种组合决?/p>

,

?/p>

S[3..0]

的值由

4

?/p>

2

进制计数?/p>

LPM_COUNTER

产生

,

计数时钟?/p>

Sclk(

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2-1;

此外

,

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M=0,

选择算术运算

,M=1

为逻辑运算

,C N

为低位的进位?/p>

;F[7..0]

为输出结?/p>

,C O

为运算后的输出进位位。两?/p>

8

位数据由总线

IN[7..0]

分别通过两个电平锁存?/p>

74373

锁入

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功能如表

2-1

所示?/p>

 

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的运算功?/p>

 

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实验二运算器实验解读 - 百度文库
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实验二运算器实验

 

1.

算术逻辑运算实验

 

一

.

实验目的

 

1.

了解简单运算器的数据传输通路?/p>

 

2.

验证运算功能发生器的组合功能?/p>

 

3.

掌握算术逻辑运算加、减、与的工作原理?/p>

 

4.

验证实验台运算的

8

位加、减、与、直通功能?/p>

 

5.

按给定数?/p>

,

完成几种指定的算术和逻辑运算?/p>

 

?/p>

.

实验内容

 

1.

实验原理

 

算术逻辑单元

ALU

的数据通路如图

2-1

所示。其中运算器

ALU181

根据

74LS181

的功能用

VHDL

硬件描述语言编辑而成

,

构成

8

位字长的

ALU

。参加运?/p>

的两?/p>

8

位数据分别为

A[7..0]

?/p>

B[7..0],

运算模式?/p>

S[3..0]

?/p>

16

种组合决?/p>

,

?/p>

S[3..0]

的值由

4

?/p>

2

进制计数?/p>

LPM_COUNTER

产生

,

计数时钟?/p>

Sclk(

?/p>

2-1;

此外

,

?/p>

M=0,

选择算术运算

,M=1

为逻辑运算

,C N

为低位的进位?/p>

;F[7..0]

为输出结?/p>

,C O

为运算后的输出进位位。两?/p>

8

位数据由总线

IN[7..0]

分别通过两个电平锁存?/p>

74373

锁入

,ALU

功能如表

2-1

所示?/p>

 

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2-1 ALU181

的运算功?/p>

 



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